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 ### Question filtre 1 : Combien de processus sont utilisés et de quelles natures sont-ils ? Comment les différenciez-vous ?
 
+Deux processus sont utilisés, le premier est un process séquentiel synchrone (on utilise un rising_edge(I_clock) pour changer d'état), et le second est un process combinatoire (on change les états futurs en fonction de l'état présent et des conditions).
 
 ### Question filtre 2 : La simulation vous permet-elle de valider votre description VHDL ? Justifiez.
 
+Oui car elle suit la séquence attendue.
 
 ### Question filtre 3 : Validez-vous la conception de l’unité de contrôle ?
 
+Oui car il y a bien une fonction de filtrage qui est appliquée au son.
 
 ### Question filtre 4 : Combien de processus sont utilisés et de quelles natures sont-ils ?
 
+Il y a 4 process séquentiels synchrones.
 
 ### Question filtre 5 : La simulation vous permet-elle de valider votre description VHDL ? Sinon, quel élément pose problème ? Comment pouvez-vous le corriger ? Justifiez
 
+Dans la simulation la séquence est bien respectée.
 
 ### Question filtre 6 : Validez-vous la conception de l’unité opérative ? Sinon, quel élément pose problème ? Comment pouvez-vous le corriger ?
+
+Premier essai avec un resize() : problème de saturation (les bits sélectionnés avec le resize n'étaient pas les bon)
+Deuxième essai avec SR_sum(14 downto 7) : pas de problème, la fonction de filtrage est bien appliquée au son.
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