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Commit d12ebd88 authored by Florian Huynh's avatar Florian Huynh
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Ajout du compte rendu avec FSM

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## Questions
### Question filtre 1 : Combien de processus sont utilisés et de quelles natures sont-ils ? Comment les différenciez-vous ?
Deux process sont utilisés. Le premier est un process synchrone qui gère le passage d'état présent à état futur avec un reset asynchrone. Le second est un process asynchrone qui permet de gérer la FSM.
### Question filtre 2 : La simulation vous permet-elle de valider votre description VHDL ? Justifiez.
La simulation permet de valider le fait que notre FSM fonctionne correctement.
### Question filtre 3 : Validez-vous la conception de l’unité de contrôle ?
Oui, l'unité de contrôle que nous avons compléter donne les résultats attendus.
### Question filtre 4 : Combien de processus sont utilisés et de quelles natures sont-ils ?
On utilise 4 process synchrones.
### Question filtre 5 : La simulation vous permet-elle de valider votre description VHDL ? Sinon, quel élément pose problème ? Comment pouvez-vous le corriger ? Justifiez
En ayant implémenter l'arrondi, la simulation montre une bonne implémentation.
### Question filtre 6 : Validez-vous la conception de l’unité opérative ? Sinon, quel élément pose problème ? Comment pouvez-vous le corriger ?
On obtient un signal filtré plus ou moins echantillonnés dépendants des paramètres atrribués.
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